news 2026/7/16 23:29:47

CANN/asc-devkit Interleave数据重排

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张小明

前端开发工程师

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CANN/asc-devkit Interleave数据重排

Interleave

【免费下载链接】asc-devkit本项目是CANN 推出的昇腾AI处理器专用的算子程序开发语言,原生支持C和C++标准规范,主要由类库和语言扩展层构成,提供多层级API,满足多维场景算子开发诉求。项目地址: https://gitcode.com/cann/asc-devkit

产品支持情况

  • Ascend 950PR/Ascend 950DT:支持
  • Atlas A3 训练系列产品/Atlas A3 推理系列产品:不支持
  • Atlas A2 训练系列产品/Atlas A2 推理系列产品:不支持
  • Atlas 200I/500 A2 推理产品:不支持
  • Atlas 推理系列产品AI Core:不支持
  • Atlas 推理系列产品Vector Core:不支持
  • Atlas 训练系列产品:不支持

功能说明

头文件路径:"basic_api/reg_compute/kernel_reg_compute_vec_interleave_intf.h"

给定源操作数寄存器srcReg0和srcReg1,将srcReg0和srcReg1中的元素交织存入结果操作数dstReg0和dstReg1中。交织排列方式如下图所示,其中每个方格代表一个元素:

函数原型

template <typename T = DefaultType, typename U> __simd_callee__ inline void Interleave(U& dstReg0, U& dstReg1, U& srcReg0, U& srcReg1)

参数说明

表 1模板参数说明

参数名描述
T目的操作数和源操作数的数据类型。支持的数据类型请参考数据类型。
U源操作数和目的操作数的RegTensor类型,例如RegTensor<half>,由编译器自动推导,用户不需要填写。

表 2函数参数说明

参数名输入/输出描述
dstReg0
dstReg1
输出目的操作数。
类型为RegTensor。
srcReg0
srcReg1
输入源操作数。
类型为RegTensor。
源操作数的数据类型需要与目的操作数保持一致。

数据类型

目的操作数与源操作数的数据类型需要保持一致。支持的数据类型为:bool、int8_t、uint8_t、int16_t、uint16_t、half、bfloat16_t、int32_t、uint32_t、float、int64_t、uint64_t。

返回值说明

约束说明

  • srcReg0、srcReg1、dstReg0、dstReg1的数据类型需要保持一致。
  • srcReg0和srcReg1可以为同一个RegTensor。
  • dstReg0和dstReg1不能为同一个RegTensor。
  • 允许源操作数和目的操作数为同一个RegTensor,例如Interleave(srcReg0, srcReg1, srcReg0, srcReg1)。
  • b64数据类型下仅支持RegTraitNumTwo。

调用示例

template<typename T> __simd_vf__ inline void InterleaveVF(__ubuf__ T* dst0Addr, __ubuf__ T* dst1Addr, __ubuf__ T* src0Addr, __ubuf__ T* src1Addr, uint16_t oneRepeatSize, uint16_t repeatTimes) { AscendC::Reg::RegTensor<T> srcReg0; AscendC::Reg::RegTensor<T> srcReg1; AscendC::Reg::RegTensor<T> dstReg0; AscendC::Reg::RegTensor<T> dstReg1; AscendC::Reg::MaskReg mask = AscendC::Reg::CreateMask<T, AscendC::Reg::MaskPattern::ALL>(); for (uint16_t i = 0; i < repeatTimes; i++) { AscendC::Reg::LoadAlign(srcReg0, src0Addr + i * oneRepeatSize); AscendC::Reg::LoadAlign(srcReg1, src1Addr + i * oneRepeatSize); AscendC::Reg::Interleave(dstReg0, dstReg1, srcReg0, srcReg1); AscendC::Reg::StoreAlign(dst0Addr + i * oneRepeatSize, dstReg0, mask); AscendC::Reg::StoreAlign(dst1Addr + i * oneRepeatSize, dstReg1, mask); } }

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