STM32F103 电源掉电预警实战：PVD 阈值档位整定、EXTI16 中断响应与触发电压实测

摘要

电池供电设备在断电瞬间丢失运行参数，是嵌入式开发里出现频率极高的痛点：Flash 写了一半掉电、寄存器数据错乱、重启后参数全部归零。本文基于 STM32F103C8T6，利用片内 PVD（可编程电压检测器）实现掉电预警，当 VDD 跌至预设阈值时，EXTI 线 16 在微秒级触发中断，为数据保存争取时间预算。实测 4 个阈值档位（2.2V~2.9V）的触发电压与数据手册典型值偏差均在 ±0.03V 以内；在 100μF 储能电容 + 50mA 负载场景下，2.9V 档触发后可用时间约 1.8ms，Flash 页编程实测 1.1ms 可完成；同时给出纹波误触发统计与 5 类故障完整排查链。全文以寄存器位定义为主线拆解配置，CubeMX 图形勾选可逐项对照理解，并附工程级代码。

一、前言

为什么需要掉电预警

做电池产品的朋友应该都有过这种经历：设备用着用着突然断电，重启后上次设置的参数、累计的计数、校准值全部丢失。更糟的情况是断电恰好发生在 Flash 写入过程中——页擦除进行到一半，主控直接掉电，重新上电后读出的数据是"一半新一半旧"的混合体，程序逻辑直接崩掉。

我最早做的一个低功耗采集终端就栽在这个坑上：现场人员频繁开关电源做测试，几天后有人反馈设备"偶尔显示乱码"。查到最后发现是掉电瞬间正好撞上参数写入窗口，把配置区写坏了。从那以后，我的所有电池方案都会把"掉电检测"当成和"看门狗"同级的必选项。

本文目标

读完这篇文章，你可以做到：

• 理解 PVD 的完整信号链：比较器 → PVDO 标志 → EXTI 线 16 → 中断服务函数
• 独立完成 PVD 初始化（含 CubeMX 与寄存器两种视角），并避开三个最容易漏的步骤
• 根据负载和储能电容，估算掉电后"可用保存时间"，并实测验证
• 面对"不触发、误触发、数据损坏"三类问题，能按排查链快速定位

前置条件：熟悉 STM32 基础外设（GPIO、中断、Flash 编程），有一块 STM32F103 最小系统板和可调直流电源。不需要任何额外传感器——PVD 是纯片内功能，这也是这个方案最大的优势。

本文完整工程代码可在 CSDN 下载频道 获取（VIP 免费）。

二、掉电检测方案对比：为什么选 PVD

在动手前，先把三条常见的技术路线摆出来对比。这个选择会直接影响硬件成本和可靠性，值得花一分钟想清楚。

方案级决策的理由：ADC 轮询最大的问题是检测延迟不可控。掉电是异步事件，轮询周期内的任何时刻断电，你都可能错过窗口；而且轮询本身还要分心处理"测量值抖动、滤波、阈值迟滞"这些琐事。外部比较器虽然实时性好，但为了一个片内就有的功能多花钱、多占 PCB 面积，对小批量产品不划算。PVD 是 ST 片内硬件比较器，专门干这件事，零成本、零延迟、中断驱动，唯一的代价是"只能判断高低、不能读具体值"。

所以我的选择很明确：PVD 做"粗报警 + 紧急保存"，ADC 做"精测量 + 低电提示"。两套机制各司其职，这也是工业产品里常见的组合打法。关于 PVD 结合 ADC 做精确电压监控的思路，可以参考这篇讨论：STM32 PVD 电源监控：原理、配置与实战避坑指南。

三、PVD 工作原理：一条完整的信号链

PVD（Programmable Voltage Detector，可编程电压检测器）本质上是一个片内电压比较器，一端接 VDD 的分压网络，另一端接一个可由 PLS 位选择的基准电压。比较结果通过 PVDO 标志输出，同时连接到 EXTI 线 16，可以配置为上升沿、下降沿或双边沿触发中断。

这条链路上每一个环节都有对应的寄存器，后面配置时我会逐个展开。先把两个关键概念说清楚：

阈值档位（PLS）：F103 提供 8 档可选阈值，从 2.2V 到 2.9V，步进 0.1V。注意这里有个容易误会的点——比较器存在回差（滞回），下降沿触发电压和上升沿恢复电压并不相等，后者大约高 0.1V 左右。这个特性后面实测部分会专门验证。

触发边沿（EXTI16）：掉电是电压下降，所以业务上只需要下降沿中断；但如果你要检测"电压恢复"事件，就得靠上升沿或者主循环里轮询 PVDO 标志。我实测中发现一个常见误区：很多人只配了下降沿，恢复时系统没有收到任何通知，标志位一直卡在"掉电状态"，下次启动逻辑错乱。这个问题在故障排查第四节细说。

掉电全过程的时序如下：

四、硬件设计：零外围，但电源路径有讲究

PVD 不需要任何外部器件，直接监测 VDD。但"监测 VDD"这件事本身有三个硬件层面的坑，直接影响触发可靠性：

第一，测量点要选对。PVD 监测的是芯片 VDD 引脚，不是电源入口。如果板子上有大电流负载（电机、射频、继电器），PCB 走线的寄生电阻会造成 VDD 引脚处的电压明显低于电源入口的测量点。我曾经在一个电机项目上发现：万用表量电源入口还是 3.1V，芯片 VDD 引脚实际已经 2.85V 了。所以调试时测量点尽量靠近 MCU 的 VDD 去耦电容。

第二，储能电容决定时间预算。从 PVD 触发到 MCU 完全失电，中间的"存活时间"主要由 VDD 上的储能电容和负载电流决定：dV/dt = I/C。这个公式是整篇文章的核心预算逻辑，第七节会用它做理论计算并与实测对照。想多争取几毫秒，就加大靠近 VDD 的电容，或者降低掉电瞬间的负载电流。

第三，电源跌落速率要可控。如果 VDD 跌落太快（比如直接拔电池、开关瞬间断开），MCU 可能在 ISR 还没来得及写 Flash 就低于最低工作电压（F103 为 2.0V，详见数据手册供电范围）。所以掉电检测方案通常和"电源路径设计"绑定：要么加储能电容，要么在 PVD 触发后立即关闭大功率外设来减缓跌落。这一点在第七节会用数据说明"够用"和"不够用"的边界。

五、软件配置：寄存器级拆解

这一节我同时给出寄存器视角和 HAL 库调用，因为 PVD 配置的每个环节都对应明确的寄存器位，理解了位定义，CubeMX 里的勾选就只是图形化而已。

5.1 使能 PWR 时钟（最容易漏的第一步）

PVD 属于电源管理（PWR）外设，使用前必须打开 APB1 上的 PWR 时钟：

• 寄存器：RCC_APB1ENR的 bit28（PWREN）
• HAL：__HAL_RCC_PWR_CLK_ENABLE()

这一步 CubeMX 不会自动生成，因为它无法判断你是否要用 PVD。漏掉它的症状很典型：PWR_CR写入完全不生效，PVD 怎么配都不触发，而且没有任何报错——这是排查 PVD 问题的头号嫌疑。

5.2 选择阈值档位并使能 PVD

阈值选择在PWR_CR寄存器：

配置级决策：为什么选 2.9V 档（PLS=111）而不是更低的档位？我的判断依据是时间预算。F103 最低工作电压 2.0V，2.9V 档触发后到 2.0V 之间有 0.9V 的电压裕量；如果选 2.4V 档，裕量只剩 0.4V，可用时间直接砍半以上。对 3.3V 供电的系统来说，2.9V 档离正常工作电压只差 0.4V，正常运行时不会误触发（回差 0.1V 也够），但能换取最长的保存窗口。如果系统对电压波动非常敏感（比如供电本身就有大纹波），再退一档到 2.7V 也不迟——这个权衡第七节的实测表会给出量化依据。关于掉电场景下阈值选择与数据落盘的完整流程，可以参考这篇：《STM32F103 PVD 掉电保护与 Flash 数据持久化实战指南》。

HAL 库对应写法：

PWR_PVDTypeDef pvdConfig={0};pvdConfig.PVDLevel=PWR_PVDLEVEL_7;/* PLS=111, 阈值 2.9V */pvdConfig.Mode=PWR_PVD_MODE_IT_FALLING;/* 仅下降沿触发中断 */if(HAL_PWR_ConfigPVD(&pvdConfig)!=HAL_OK)/* 参数校验, 非法返回 HAL_ERROR */{Error_Handler();}HAL_PWR_EnablePVD();/* PVDE = 1 */

注意HAL_PWR_ConfigPVD是带返回值检查的，HAL 库 1.8.x 之前某些早期版本没有这个检查习惯，建议显式判断返回值，参数写错（比如 PVDLevel 传了非法值）时能第一时间暴露。

5.3 配置 EXTI 线 16 与 NVIC

PVD 输出接到 EXTI 线 16，涉及四个寄存器位：

NVIC 侧使能PVD_IRQn。注意 PVD 的 NVIC 优先级建议给高一些（比业务中断高），因为掉电保存是"最后的机会"，不能被其他中断长期阻塞。

/* EXTI16 配置与 NVIC（HAL_PWR_ConfigPVD 内部已处理 EXTI 边沿, 这里只需使能中断通道并设置优先级） */HAL_NVIC_SetPriority(PVD_IRQn,1,0);/* 抢占优先级 1, 高于业务中断 */HAL_NVIC_EnableIRQ(PVD_IRQn);

如果用的是标准外设库，这段对应EXTI_InitStructure.EXTI_Line = EXTI_Line16; EXTI_InitStructure.EXTI_Mode = EXTI_Mode_Interrupt; EXTI_InitStructure.EXTI_Trigger = EXTI_Trigger_Falling;，效果等价。

5.4 中断服务函数

voidPVD_IRQHandler(void){/* 确认是 PVD 触发的 EXTI16 中断 */if(__HAL_PWR_PVD_EXTI_GET_FLAG()!=RESET){__HAL_PWR_PVD_EXTI_CLEAR_FLAG();/* 写 EXTI_PR bit16 清除挂起 */PowerFail_Handler();/* 掉电紧急处理 */}}

5.5 掉电保存处理函数

掉电场景下的处理原则是：只做最必要的事，越快越好。我通常按这个顺序执行：

1. 置位volatile掉电标志，供主循环和恢复逻辑判断
2. 关闭大电流外设（电机 PWM、射频、屏幕背光），减缓 VDD 跌落
3. 把关键数据写入内部 Flash（复用之前内部 Flash 模拟 EEPROM 的双页轮换方案）

volatileuint8_tpower_fail_flag=0;/* 中断与主循环共享, 必须 volatile */staticvoidPowerFail_Handler(void){power_fail_flag=1;/* 1. 置掉电标志 *//* 2. 关闭大电流外设, 减缓 VDD 跌落 (顺序依赖: 先停 PWM 再停定时器, 避免 TIM 停止瞬间引脚电平跳变产生额外尖峰) */HAL_TIM_PWM_Stop(&htim2,TIM_CHANNEL_1);HAL_GPIO_WritePin(LED_GPIO_Port,LED_Pin,GPIO_PIN_RESET);/* 3. 写关键数据到内部 Flash (页编程典型 1ms, 实测见第七节) */EEPROM_Write(SAVE_ADDR,(uint8_t*)&save_counter,sizeof(save_counter));/* 写完后保持, 等待 VDD 继续跌落复位 */}

注意power_fail_flag必须加volatile——它在中断里被修改、主循环里被读取，不加的话编译器可能把主循环里的判断优化成"永远为假"。

主循环里做恢复检测：

while(1){/* 掉电恢复: PVD 只配了下降沿, 恢复(上升沿)靠轮询 PVDO 状态 */if(power_fail_flag&&__HAL_PWR_GET_FLAG(PWR_FLAG_PVDO)==RESET)/* PVDO=0 说明 VDD 已回到阈值之上 */{power_fail_flag=0;Restore_From_PowerFail();/* 重新初始化外设, 恢复运行 */}/* 正常业务循环 */}

六、容易漏掉的三个步骤

这三步 CubeMX/HAL 都不会自动帮你做，漏掉任何一个，现象都很难猜：

1. PWR 时钟使能（__HAL_RCC_PWR_CLK_ENABLE()）
上面说过，漏掉的症状是"PVD 完全不触发且无报错"。CubeMX 生成代码里默认不含这一步，必须手动加在MX_PWR_Init或 main 里。我第一次做的时候就是漏了它，在 PVD 配置上反复查了半小时，最后用调试器单步看PWR_CR才发现寄存器根本没写进去。

2. EXTI 边沿选择（PWR_PVD_MODE_IT_FALLING）
如果用了默认的PWR_PVD_MODE_NORMAL（标准库的EXTI_Trigger_None），EXTI16 永远不会进中断，但 PVDO 标志其实在变化——所以现象是"标志位能读到、中断就是不进"。用调试器观察EXTI->PRbit16 是否置位就能快速区分是边沿配置问题还是 NVIC 问题。

3. 掉电标志的 volatile 声明
中断里置位、主循环读取的共享变量必须volatile。这个坑在优化等级 O2 以上才会暴露：主循环里反复读同一个非 volatile 变量，编译器会把值缓存到寄存器，导致"掉电后程序毫无反应"。这是编译器行为问题，工具链不会给你任何提示。

七、测试验证：阈值实测、时间预算与误触发统计

测试平台：STM32F103C8T6 最小系统板，可调直流电源（0~5V，纹波 <10mV），示波器探头直接接在 VDD 去耦电容两端。软件侧在PowerFail_Handler里翻转一个 GPIO，用示波器记录"电源电压跌至阈值"到"ISR 执行"的延迟。

7.1 阈值档位扫描：4 档实测 vs 数据手册

用电源缓慢下降（约 0.05V/s，排除跌落速率影响），逐档记录下降沿触发电压；再用电源缓慢回升记录恢复电压。与 STM32F103 数据手册（DS5319 的 PVD 阈值表）对照：

理论 vs 实测对照结论一：触发电压与手册典型值偏差在 ±0.03V 以内，全部落在手册给出的 min/max 区间，说明 PVD 比较器一致性很好，可以直接信任档位标称值做设计预算。同时可以看到回差实测约 0.12~0.14V，与手册"上升沿比下降沿高约 0.1V"的描述吻合——设计阈值时要给回差留出裕量，否则恢复检测可能误判。

7.2 掉电保存时间预算：理论计算 vs 实测

预算模型：PVD 触发后，VDD 从阈值（2.9V）跌至最低工作电压（2.0V）之前，就是可用的保存窗口。按恒流放电近似，可用时间 T = C × (2.9 - 2.0) / I。

理论 vs 实测对照结论二：实测可用时间比理论值低约 5%~15%，原因是放电初期 MCU 还在全速运行（消耗的电流比"关闭外设后"更大），放电曲线并非严格的线性恒流。偏差方向与量级符合预期。这个表的工程含义很直接：如果产品掉电瞬间负载有 150mA 量级，100μF 根本不够，要么加大到 470μF，要么在 PVD 触发后第一时间切断负载——两种手段的实测余量差了一倍以上。

7.3 量化参数对比：不同阈值档位下的误触发统计

把供电电压稳定在 3.3V，人为注入不同幅度的纹波，观察 1 小时内各档位的误触发次数（每个档位测试前先让系统稳定 10 分钟）：

数据说明：3.3V 供电下，2.9V 档距离正常电压只有 0.4V，当纹波达到 200mV（叠加瞬间压降）时已经偶尔能摸到阈值下沿，出现误触发；而 2.7V 档留了 0.6V 裕量，同样条件下纹丝不动。这组对比就是"选 2.9V 换时间预算、还是选 2.7V 换稳定性"的量化依据——电源质量差的板子优先 2.7V 档，电源干净且掉电保存优先级高的场景再上 2.9V。PVD 触发后的机制细节与基础代码，可参考 《stm32 的掉电检测机制——PVD》。

八、故障排查：5 类高频问题与完整排查链

8.1 PVD 中断完全不触发

症状：电压已经明显低于阈值，串口/调试器看不到任何中断迹象，PVDO 标志也不变。

排查链：先用调试器读PWR_CR，确认 PVDE=1、PLS 是目标档位（工具验证）。若PWR_CR读出来全是 0，说明写入根本没生效，假设是 PWR 时钟没使能——RCC_APB1ENR的 bit28（PWREN）置 1 后重试，发现PWR_CR可写了（排除/确认）。若PWR_CR正常但 PVDO 不变，假设比较器没工作，改用示波器直接看 VDD，确认电压确实低于阈值（排除电源测量误差）。最后检查EXTI->IMRbit16 和NVIC->ISER中 PVD_IRQn 位（根因：常见于只配了 PVD 没开 EXTI16 中断屏蔽，或 NVIC 没使能）。修复后拉低电源验证 ISR 进入（验证修复有效）。

最常见原因：PWR 时钟未使能，其次是 NVIC 未使能 PVD_IRQn。

8.2 触发电压与设定档位偏差超过 0.1V

症状：设 2.9V 档，实测 2.75V 就触发了。

排查链：先确认 PLS 位序没配错（工具验证：读PWR_CRbit4:2，注意 PLS 是 [4:2] 不是 [3:1]，标准库枚举值PWR_PVDLEVEL_7对应二进制 111）。若寄存器无误，假设是测量点压降——万用表量电源入口，而 PVD 看的是 VDD 引脚，走线电阻在负载电流下产生压降（排除/确认：把测量点挪到 VDD 去耦电容处，示波器测，偏差立刻缩小）。若偏差依旧，检查电源跌落速率，太快时比较器输出有响应延迟，示波器上看到的是"已经跌过阈值一段距离才翻转"（根因：测量方法与电气延迟叠加）。放慢跌落速率到 0.1V/s 级别复测，触发电压与标称档位吻合（验证修复有效）。这类阈值偏差与响应延迟问题在社区讨论里很常见，参见 STM32F4 掉电检测常见技术问题。

8.3 频繁误触发

症状：正常 3.3V 供电，系统时不时进 PVD 中断，一天好几次。

排查链：先用示波器（AC 耦合、20MHz 带宽限制）看 VDD 纹波（工具测量），如果纹波峰峰值超过阈值裕量（3.3V - 档位 - 回差），假设是纹波/瞬间压降触发——特别留意大负载开启瞬间的跌落尖峰（排除/确认：抓电机启动波形，确认跌落幅度和宽度）。根因通常有二：一是阈值档位离 3.3V 太近（见 7.3 节 200mV 纹波时 2.9V 档误触发 7 次），二是储能电容老化或 ESR 偏高导致动态压降大。修复方向：退一档阈值（2.9V→2.7V），或在负载侧加本地大电容吸收瞬态。修复后连续跑 24 小时统计误触发次数归零（验证修复有效）。

8.4 掉电保存的数据损坏

症状：掉电后重启，读回的数据是旧值和新值混合，或校验和错误。

排查链：先复现并抓取 VDD 波形，计算从 PVD 触发到 Flash 写完的实际耗时，与实测可用时间对比（工具测量：示波器看 ISR 里 Flash 写完成引脚翻转的时间点）。如果可用时间 < 写入时间，根因是时间预算不足（对应 7.2 节 150mA/100μF 那行"写不完"的场景）。修复手段按优先级：PVD 触发后立即关大负载、加大储能电容、减少单次写入数据量（一次页编程 1ms，改为只写必要的最小数据块）。如果时间预算充足但仍损坏，假设是写 Flash 过程中被更高优先级中断打断——检查HAL_FLASH_Program调用链是否在临界区，必要时在写 Flash 前__disable_irq()（确认：加临界区保护后数据不再损坏）。修复后连续断电 50 次，校验全部通过（验证修复有效）。

8.5 掉电恢复后系统状态异常

症状：重新上电后，设备进入"掉电模式"的逻辑，功能不恢复，或行为像"没保存过"。

排查链：先读PWR_CSR的 PVDO 位，确认恢复后 PVDO=0（工具验证：电压回升后标志应自动清零）。如果 PVDO 正常但逻辑仍卡在掉电分支，假设是恢复检测逻辑缺失——前面说过，PVD 只配了下降沿，恢复事件没有中断通知，必须主循环轮询 PVDO（根因：恢复处理遗漏，这是 5.2 节提到的常见误区）。修复：在主循环加 PVDO 轮询 + 掉电标志复位逻辑。如果 PVDO 一直为 1 不复位，说明 VDD 实际没回到阈值之上（含回差），假设是供电不足或档位选得离工作电压太近，检查电源实际带载电压（确认）。修复后做完整断电-上电循环 20 次，每次都能正常恢复业务（验证修复有效）。

九、总结

回顾这篇文章的核心要点：

• PVD 是一条完整硬件信号链：比较器（VDD vs PLS 基准）→ PVDO → EXTI16 → PVD_IRQn，全程无需外部器件，触发延迟微秒级
• 配置上有三个工具链不会帮你做的步骤：PWR 时钟使能、EXTI 下降沿选择、共享标志的 volatile 声明，漏掉任何一个现象都很难猜
• 阈值档位是"时间预算"和"误触发风险"的权衡：2.9V 档给最多保存时间（实测 100μF/50mA 下 1.8ms），但纹波大的板子建议退到 2.7V 档
• 可用保存时间的核心公式是 T = C × ΔV / I，实测比理论低 5%~15%，设计时要留余量

适用边界：本文方案适用于 VDD 直接供电、掉电事件频率不高的产品（电池设备、仪表、家电控制板）。PVD 只有 8 档固定阈值，需要"精确电压读数"的场景必须配合 ADC；系统存在"上电瞬间电压爬坡慢"的情况时，还要注意上升沿触发与启动时序的配合。对于工作电压低于 2.0V 的极低压系统，PVD 档位无法覆盖，需要外部方案。

局限性与已知问题：本测试的触发电压一致性基于单颗芯片（出厂批次未知），批量生产时建议每批抽测 2~3 颗确认阈值分布；掉电保存的时间预算依赖储能电容容值和负载模型，产品定型后建议做 50 次以上断电循环验证。

扩展方向：① 把 PVD 与低功耗模式结合，掉电前先进入 STOP 保持数据、等待完全失电；② PVD 触发后通过 ADC 分压通道精确记录"触发时的实际电压"，配合 RTC 记录掉电时间戳；③ 双阈值设计——PVD 做紧急保存，ADC 轮询做低电提醒，两级告警联动。内部 Flash 模拟 EEPROM 的双页轮换写入方案可以参考我的另一篇文章，掉电保存的写入部分直接复用了那套代码。

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版本备注

• 硬件平台：STM32F103C8T6 最小系统板（VDD 3.3V，可调直流电源供电）
• 软件版本：STM32CubeIDE 1.15.1 + STM32CubeF1 HAL 库 1.8.6，编译优化 O2
• 兼容说明：PVD 功能在 F1/F4/L4 全系通用，代码可直接移植（F4/L4 的阈值档位范围不同，L4 为 2.0V~2.8V，需对照对应数据手册调整 PVDLevel 枚举）
• API 变更风险：HAL 库 1.8.x 的HAL_PWR_ConfigPVD参数结构为PWR_PVDTypeDef（含 PVDLevel/Mode 两字段），与 1.6.x 及标准外设库的PWR_PVDLevelConfig + EXTI_Init写法不兼容，迁移时注意

参考资料

• STM32F4 PVD 电源监控防止欠压损坏 — F4 平台的 PVD 配置与中断处理对照
• 《STM32F103x8/xB 数据手册》（DS5319）PVD 电气特性表、RM0008 参考手册电源管理章节