CS5801AN HDMI转eDP/DP参考设计拆解与调试要点

简介：CS5801AN HDMI to eDP/DP转换方案电路原理图面向硬件工程师、显示接口开发及需要做HDMI转eDP/DP方案评估的读者，提供一套可对照的参考设计图纸，用于理解桥接芯片外围连接、接口设计与供电划分。压缩包仅含1个PDF文件，约775KB，内容以原理图页为主，涵盖HDMI输入、CS5801AN主芯片、DP/eDP输出、AUX与HPD、复位及测试点等部分。图中可见HDMI差分对、DP TX通道、CFG_SCL/SDA、HDMI_SCL/SDA等信号，以及1.2V/3.3V多路供电域和DC-DC电源架构，便于核对引脚分配与电源去耦。已有1475人学习，说明该方案在显示转换设计中具有一定参考热度；读者可据此梳理信号流向、检查接口电平与调试测试点，为原理图评审、方案选型和PCB设计前的资料核对提供依据。

1. 一块四页 A3 的参考设计，值不值得花两晚拆透

前阵子帮人看一块转接板，1080p 点亮没问题，一切到 4K 就黑屏，对方怀疑芯片本身不行。把图纸要过来一看，四页 A3，主芯片 CS5801AN，从 HDMI 输入、ESD、双路 Buck 电源、DP 源端输出一路画到测试点，页脚标着 Rev V1.0。这份 CS5801AN 的 HDMI to eDP/DP 转换方案电路原理图，价值不在“能亮”，而在于它把每个电源域、每根边带信号、每个可选电阻都摆出来了，出问题时有地方可查。适合三类人：正在选 HDMI 转 eDP/DP 桥接方案的产品工程师、要照着改一版自己 PCB 的硬件、以及手上已经有板子但被兼容性折腾到怀疑人生的调试者。

2. HDMI 输入侧：四对 TMDS 从 J2 走到主芯片的这 8 根线

图纸第一页是方块图，第二页才是主芯片，HDMI 输入这半边加起来不到 30 个元件，却决定了后面八成以上的兼容性问题。J2 是标准 19 pin A 型母座，四对差分（CK、D0、D1、D2）进来先过两颗 TVS 阵列，再进 U1 的 2～12 脚；边带信号 HPD、SCL、SDA、+5V 检测各自有一小套电阻网络。这页图纸最值得学的不是连线本身，而是它对“保护器件放在哪、上拉拉到哪里、检测电阻怎么分压”这几个动作的处理方式。

2.1 19 pin 接口与两颗 ESD 管的保护半径

先看 J2 的引脚分配，这是所有后续走线的基准：

CEC 和 HEC 在这版设计里是空着的，这不算偷懒。CEC 要做完整的单线协议栈，HEC 需要额外的差分对和以太网通道，转接板场景基本用不到。悬空是安全的，但如果你的板子要过某些整机厂的兼容测试，CEC 脚最好加一个 27k 下拉到地，避免长线悬空拾取噪声后被源端误判。

两颗 U2、U3 是 Clamp0524t 这类四通道 TVS 阵列，一颗管 CK 和 D0，一颗管 D1 和 D2，正好覆盖 8 根 TMDS。选型上要看三个参数：结电容要小（这类器件通常在 1pF 量级以内，超过 2pF 就会在 3Gbps 以上开始啃眼图）、钳位电压不能高于芯片 IO 的绝对最大额定值、动态电阻要低。图纸里把它们放在连接器和主芯片之间，这是对的顺序——先钳位再进芯片，不能反过来。布局上有个血泪经验：TVS 的地引脚要单独打孔直接下主地平面，不要和信号地串在一起走一段再下地，那段共用的地路径会把钳位电流的压降耦合回信号线，等于白装。

DDC 的两根线用 R16、R17 各 47k 上拉到 HDMI_5V。注意是拉到 5V 而不是 3.3V，因为 DDC 在 HDMI 规范里是 5V 域信号，拉到 3.3V 会让某些源端的开漏输出拉不干净。47k 这个值偏大，是配合芯片内部上拉用的折中：好处是源端灌电流小、功耗低，坏处是线材稍长、线容稍大时上升沿就变缓，读 EDID 开始出现随机失败。如果你的板子要配长线，把这两个电阻换成 2.2k 会更稳，代价是静态电流上去一点。

2.2 差分对映射与 PN SWAP 这颗后悔药

四对 TMDS 进芯片的引脚顺序是固定的：CK 走 2/3，D0 走 5/6，D1 走 8/9，D2 走 11/12。P/N 的极性在 HDMI 侧不能随便翻，因为源端的 TMDS 编码对极性敏感（虽然差分本身理论上可以翻转，但接收端的数据对齐依赖正确的极性约定）。真正需要留后悔药的是 DP 输出侧——图纸在 U1 到 J3 之间标了一处“DP TX PN SWAP”，用 0R 电阻做成可交叉的焊盘。PCB 走线如果因为连接器摆位被迫交叉，或者第一版打样发现 lane 顺序接反，不用割线飞线，改贴 0R 就能救回来。

差分走线的约束按 3.4Gbps/lane 这一档来定比较稳妥，也就是 4K30 的带宽余量：对内等长控制在 ±5mil，对间 skew 控制在 ±50mil，差分阻抗 100Ω±10%。想跑 4K60 就得看芯片手册给的最高 TMDS 速率，图纸本身不解决带宽上限，它只保证信号完整性不拖后腿。测试点 TP1～TP6 分布在 SPI 和 CFG 上，TP15 是 UART_TX，图纸上专门写了两遍“注意：请预留调试用测试点”，这句话值得印在每块板子上——差分对上不要随便挂测试点，挂了就是一段 stub，1～2mm 的 stub 在 3Gbps 下足以让眼图闭合。

2.3 HPD、DDC、SRC_DET：三条最容易漏的边带

只连四对差分、不接边带，是新手最常翻的车。插上没反应、系统里看不到显示器，十有八九出在这三根线上。

HPD 走 J2 的 19 脚，直接进 U1 的 18 脚，该引脚标了 5T，意思是 5V 耐压。HDMI 规范里 HPD 由 sink 侧拉高（通常经 1k 上拉到 +5V）通知源端“我接上了”，所以芯片内部必须有对应的上拉或驱动能力。调试时第一个要量的就是这根：插上线，HPD 应该从低变高，不变就是芯片没工作或者配置没加载。

SRC_DET 这根更隐蔽。HDMI_5V 经 R18（100k）串进来，再用 R19（1M）下拉到地，节点电压约 5×1M/1.1M≈4.55V，接 U1 的 17 脚 HDMI_DET。串 100k 是限流保护，1M 下拉是保证拔线后节点能快速泄放到低电平，不会因为残留电荷让芯片以为源端还在。这个分压比看起来“几乎没分压”，但配合 5T 耐压脚是合理的——它检测的是“有没有 5V”，不是精确电压值。如果换成 3.3V 耐压的普通 IO，就必须改成分压到 3V 以下，别照抄。

+5V 本身来自 USB 口 J1，经 D2（B5819WS）肖特基进来，D3 是另一路防反灌。肖特基的正向压降在这里是个真实损耗：源端输出 5V，过二极管剩 4.7V 左右，再经 100k 串阻，检测节点实际只有 4.2V 上下。所以量 HPD 和 SRC_DET 的时候，别拿 5.0V 当基准去判断“电压不够”，要按链路逐级扣。

3. 电源树拆解：九个电源域与两路 SY8088 的取值算法

第三页是电源，只有两颗 SY8088、两个 10uH 电感和一堆电容，看起来简单，但 U1 一共要吃九个电源域，任何一个去耦不到位，表现出来都是“玄学问题”：今天能亮明天不能亮、换个屏就好、温度一高就花屏。这页的关键不是芯片选型，而是电压值怎么算出来、去耦怎么分配、上电顺序怎么保证。

3.1 DVDD12 / DVDD33 与六个模拟域的划分

把 U1 的电源脚按域归一下类，思路立刻清楚：

去耦的分配是：每个电源脚配一颗 0.1uF（C3～C7、C10～C14、C16～C26），每个域再配一颗 4.7uF 做局部储能（C2、C9 给 DVDD12，C15、C21 给 DVDD33）。这个组合是标准做法，但有两个细节决定成败：0.1uF 的走线到引脚要控制在 2mm 内、过孔直接下地平面，不能先拉到一条公共的电源细线上再分叉；4.7uF 要放在域的入口，不要和 0.1uF 挤在一起，否则大电容的 ESL 会把高频旁路效果抵消。

图纸里所有域都是直接从两路 Buck 分出去的，没有加磁珠隔离。自己改板时我一般会在 GTX_AVDD12_PLL、APLL_VDDU_12 前面各加一颗 600Ω@100MHz 的磁珠，再补一颗 1uF，把 SerDes 和音频 PLL 的电源噪声和数字域隔开。这不是图纸的错误，是参考设计为了简化 BOM 做的取舍，量产板上这点成本值得花。

3.2 反馈电阻与电感取值：把 1.2V 和 3.32V 算出来

U4 和 U5 都是 SY8088 系列，FB 基准 0.6V，输出电压由反馈电阻决定。图纸上 U4 的 R23=100k、R20=100k，套公式 Vout=0.6×(1+R23/R20)=1.2V；U5 的 R1=10k、R2=2.2k，Vout=0.6×(1+10/2.2)=3.327V，图上注释直接写了 3.32V。

这里有个容易看岔的地方：U4 那一页的标题写的是“DCDC 5V->1.0V”，但实际阻值算出来是 1.2V，网络名也叫 DVDD12。以阻值为准，1.2V 才是芯片要的电压。照标题去改电阻会直接烧板子。

# 反馈电阻取值校验：SY8088 系列 FB 基准 0.6V VFB = 0.6 def vout(r_top, r_bot): """r_top 为上反馈电阻(接 Vout 与 FB)，r_bot 为下反馈电阻(FB 到地)，单位 Ω""" return VFB * (1 + r_top / r_bot) def pick_bottom(r_top, target, e24=(1.0, 2.2, 3.3, 4.7, 10.0, 22.0)): """给定上电阻和目标电压，在常用阻值里挑下电阻，返回最接近的组合""" best = None for k in e24: r_bot = k * 1000 err = abs(vout(r_top, r_bot) - target) / target if best is None or err < best[1]: best = (r_bot, err) return best print(round(vout(100_000, 100_000), 3)) # 1.2V -> DVDD12 print(round(vout(10_000, 2_200), 3)) # 3.327V -> DVDD33 print(pick_bottom(10_000, 3.3)) # 找 3.3V 档的下电阻

这段代码干两件事：把图纸里的两组阻值代进去验算，确认 1.2V 和 3.327V 不是笔误；再给定上电阻去反推下电阻，方便你换成 E96 系列 1% 精度的组合。实际改板时把误差控制在 ±2% 以内就够，DVDD12 的容忍度比 DVDD33 更宽，但别超过 ±5%，SerDes 对核心电压很敏感。

电感两颗都是 10uH，输入 10uF/16V（C38、C40），输出 100uF/6.3V（C42、C45）加 0.1uF，另外 C47、C48 是 22pF 前馈电容，并在上反馈电阻两端。前馈电容的作用是改善负载瞬态响应，但容值不能大：22pF 配 100k 上电阻，零点在几百 kHz，刚好补偿环路；换成 220pF 就可能让环路相位裕度不够，轻载时输出抖动。这个位置我见过有人随手贴 1nF，结果 1.2V 输出上叠了几十 mV 的低频振荡，DP 链路训练时好时坏，查了两天才定位到。

3.3 上电顺序、RESET 与 strap 配置脚

两路 Buck 是各自独立的，没有时序控制芯片，所以 1.2V 和 3.3V 谁先起来取决于负载和软启动，理论上可能相差几百微秒。这种设计靠的是 RESET 的 RC 延时兜底：R4 是 10k 上拉到 DVDD33，C27 是 0.1uF 到地，时间常数 τ=10k×0.1uF=1ms，复位释放大约在 3τ≈3ms。这个延时足够让 1.2V 建立到 90% 以上，但如果你的输入 5V 上升很慢（比如走 USB PD 协商），3ms 可能不够，表现就是偶发不启动、必须拔插一次。

# RESET RC 延时估算：按 3τ 认为复位有效释放 R = 10_000 # R4，单位 Ω C = 0.1e-6 # C27，单位 F tau = R * C print(f"tau = {tau*1e3:.2f} ms, 3tau = {tau*3*1e3:.2f} ms") # 若输入 5V 上升时间超过 1ms，建议把 C27 换 1uF，3tau 拉到 30ms

参数说明：R 是上拉电阻，C 是复位脚对地电容，3τ 是工程上常用的“充到 95%”判据。改大电容的代价是复位释放变慢，如果系统对首次点亮时间有要求，别一味加大，1uF 对应 30ms 已经是比较保守的值。

配置脚这边，CFG_SCL 和 CFG_SDA（pin 26、27）各经 10k 上拉到 DVDD33（R2、R3），这是一条独立的配置总线，用于外部工具读写芯片参数。这类桥接芯片的配置脚在 RESET 释放的瞬间会被采样

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