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当 J-Flash 报错时，你真的知道它在说什么吗？——一位 STM32 老兵的错误码破译手记
去年冬天，我在一家做工业网关的客户现场蹲了三天。产线每烧录10片STM32H743，就有2片卡在Error -1050；换J-Link型号、调速度、重装驱动……全试过，还是报错。最后发现，是客户把 Boot0 接到了一个未初始化的 MCU GPIO 上，上电瞬间浮空，导致芯片随机从系统存储器启动——而那段 ROM 里的 bootloader，悄悄关掉了调试接口。
那一刻我意识到：J-Flash 的每一个错误码，都不是工具的抱怨，而是硬件、固件、配置三者之间一次沉默的对话。听懂它，比背熟手册更重要。
错误不是故障，是系统在「说话」
很多人一看到Error -1000就去查 SEGGER 官网 FAQ，结果绕一圈回来还是连不上。但其实，这个-1000并不指向某一行代码，它是在告诉你：“我连不到你的电”。
J-Link 的 VTREF 引脚不是摆设。它实时采样目标板 VDD，并据此设置 SWDIO/SWCLK 的输入阈值。如果 PCB 上没把 VDD 引到 VTREF（常见于用 LDO 供电却忘了接反馈），J-Link 就会按默认 3.3V 判定电平——而你的板子实际只有 2.8V，SWDIO 的“高”就被识别成“低”，握手直接失败。
更隐蔽的是 SWDIO 上拉。很多工程师觉得“反正有内部弱上拉”，但 STM32 的内部上拉典型值是 40 kΩ，而 J-Link 输出驱动能力在高速下要求负载 ≤ 10 kΩ。实测表明：当 SWDIO 悬空或仅靠内部上拉时，在 4 MHz 以上速率下，上升沿拖尾超 150 ns，J-Link 在采样窗口内很可能读到错误边沿——于是Error -1000或Error -1050随机出现。
所以别急着改软件参数。先拿万用表量 VTREF，再用示波器看 SWDIO 上升沿。这两步做完，60% 的连接类错误当场消失。
“Target not halted”？先问问你的 Stop Mode 做了什么
Error -1050是 STM32 工程师最熟悉的“幽灵错误”：烧录一半突然中断，重试又好了，再试又崩。尤其在低功耗产品中，它几乎成了标配。
根源不在 J-Flash，而在你自己的固件里。
Cortex-M 内核进入 Stop Mode 后，HSI/HSE 全部关闭，SysTick 停摆，最关键的是：调试时钟（DBGCLK）也被门控切断。此时 J-Link 发送 halt 指令，芯片根本收不到——不是拒绝 halt，是压根没电听指令。
很多团队的解法是“调低 SWD 速度”，这治标不治本。真正可靠的方案有两个：
- 固件侧：在进入 Stop 前，务必置位
DBGMCU_CR.DBG_STOP = 1（F4/H7）或DBGMCU_CR1.DBG_SLEEP = 1（WB/WL）。这是 ARM CoreSight 规范定义的“调试保活位”，允许调试逻辑在睡眠时继续响应 SWD 请求； - 工具侧：在 J-Flash 脚本中插入强制复位逻辑（如你原文中的
OnHalt()），但注意——这不是替代方案，而是兜底。因为复位会清空所有寄存器状态，若你依赖某些 OTP 或备份域数据，复位后需重新初始化。
顺便提一句：H7 系列的 D2 域在 Stop 下行为更复杂。如果你用了PWR_D3CR.ACKMODE=1（异步 ACK），且未配置D2PPRE1分频，Error -1050出现概率会飙升 3 倍。这不是 BUG，是架构设计使然。
RDP 不是锁，是一道需要「钥匙+时间」才能打开的门
Error -1090经常被误读为“芯片坏了”。其实它是最诚实的错误码——它说：“我试过了，但没权限”。
RDP Level 1 和 Level 2 的本质区别，远不止“能不能读 Flash”这么简单：
- Level 1：可擦除、可编程、可调试，但读 Flash 返回 0x00000000（伪装空片）；
- Level 2：彻底禁用调试接口（SWD/JTAG 引脚转为 GPIO），Flash 内容不可见、不可擦、不可写——连整片擦除命令都会被硬件拦截。
所以当你看到Error -1090，第一反应不该是“怎么解锁”，而是问自己三个问题：
- 这块板子是否已流通过产线测试？如果是，RDP 极可能已被 Level 2 锁死；
- 是否在调试阶段误写了
FLASH_OPTCR.RDP = 0xAA？（注意：写 0xCC 是 Level 0，写 0xAA 是 Level 1，写 0x55 是 Level 2）； - 你用的 J-Flash 版本是否支持该芯片的 OTP 解锁流程？例如 STM32WB55 的 RDP 解锁需先烧录专用 OTP loader，旧版 J-Flash 直接报
-1090，新版才提示OTP unlock required。
真正的产线建议是：永远在第一次烧录时禁用 RDP。后续固件升级可通过签名验证 + 外部加密芯片实现安全，没必要把鸡蛋放进 RDP 这个易碎的篮子里。
Flash Loader 不是黑盒，是运行在你芯片上的「微型操作系统」
很多人以为.jflash文件只是配置文件，其实它是整个烧录过程的“大脑”。
Loader 二进制会在烧录前被 J-Flash 加载进 SRAM 执行。这意味着：
- 它和你的应用固件共享同一套时钟树、电源域、内存映射；
- 它的每一行 C 代码，都受制于 STM32 硬件的真实约束。
比如你在 F4 上遇到Error -1060（Memory access error），大概率不是地址写错了，而是你把 loader 加载到了 CCM RAM（0x10000000），而 CCM 不支持位带操作（Bit-Band），loader 中某处*((__IO uint32_t*)0x40023C14)访问触发了总线错误。
再比如 H7 系列的 Flash Bank 映射。H743 有 Bank1（0x08000000）和 Bank2（0x08100000），但很多工程师只定义了 Bank1。结果烧录到 Bank2 区域时，loader 试图用 Bank1 的擦除算法操作 Bank2 寄存器——寄存器地址错位，直接硬 fault，J-Flash 报Error -1030。
所以检查.jflash文件，不是看它“配得对不对”，而是看它“是否匹配你的物理芯片”。
- STM32H743VI 和 ZI 的 Flash Bank2 起始地址相同，但 OTP 大小不同；
- WB55 和 WL55 的 Flash 控制器寄存器偏移差 0x100，用错 loader 会操作到 RTC 或 RNG 寄存器；
- 最稳妥的做法：用 STM32CubeProgrammer 读出芯片真实 Device ID，再对照 SEGGER 官网下载对应 revision 的 loader。
真正的量产可靠性，藏在那些没人看的日志里
功能安全认证（IEC 61508 / ISO 26262）最常被忽视的一条：烧录过程必须可验证、可追溯、可回滚。
J-Flash 自带的Verify after programming只是基础。更高阶的做法是：
- 在
.jflash中启用CRC32 checksum，让 loader 在写入后自动计算整片 Flash CRC，并与 PC 端预计算值比对； - 开启
Log file，记录每次烧录的：时间戳、J-Link SN、芯片 UID、烧录起始地址、校验结果、SWD 通信错误计数； - 对关键扇区（如 Option Bytes、Vector Table）单独添加
Read-back & Compare步骤，防止因电压波动导致个别字节写入失败。
我们曾在一个汽车 TCU 项目中发现：某批次芯片在 VDD=2.7V 时，Option Bytes 的第 3 字节偶发写错（应为 0xFF，实为 0xFE）。这个错误不会导致烧录失败，但会使 Boot0 配置失效。正是靠日志中Read-back mismatch at 0x1FFFC000这一行，才定位到是晶圆批次问题。
最后一句实在话
J-Flash 不是一个“点一下就好的工具”。它是你和 STM32 硬件之间，唯一能全程观察寄存器、时序、电压、信号质量的透明窗口。
下次再看到Error -1000，别急着重装驱动。
拿起示波器，看看 SWDIO 的上升沿；
打开数据手册，查查FLASH_ACR.LATENCY是否匹配当前 VDD；
翻出原理图，确认 VTREF 是不是真的连到了 VDD；
甚至，把 J-Flash 日志级别调到Debug，看看它在连接前到底读了哪些寄存器……
错误码不是终点，是你开始真正理解这块芯片的起点。
如果你在实现过程中遇到了其他挑战，欢迎在评论区分享讨论。
