张小明
前端开发工程师
时序分析报告，是时序分析器对于约束后的设计进行时序分析，得出的结论。可以查看约束后的效果是否满足时序要求。
IO输入延时约束分最大、最小两种约束，之所以有最大和最小两种约束，是因为器件的datasheet中的延时数值一般会有个最小值到最大值的变化范围。例如某器件的datasheet中关于延时的参数最小0.7ns，典型1.3ns，最大2.3ns：
如下图所示，Clkin的上升沿后，数据会从第1个寄存器的D端口经过Tco的延时到达同一个寄存器的Q端口，然后再经过TD到达下一个寄存器的D端口，这段路径的最大值=Tco_max + TD_max，而最小值=Tco_min + TD_min。
约束可以按照：
create_clock-period10-name sysclk[get_ports clkin]set_input_delay <的确，我们现在用的电脑CPU，绝大多数还是 Intel 或 AMD（两个都是美国牌子）。 所以CPU 这种核心东西，短时间内看起来还是绕不开美国。 但现实，已经开始悄悄反转了。 近些年，一个不太起眼却持续扩…
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李华